Xilinx SDAccel開發(fā)環(huán)境通過Khronos OpenCL標(biāo)準(zhǔn)測(cè)試

時(shí)間：2015-01-16

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導(dǎo)語：SDAccel開發(fā)環(huán)境結(jié)合了業(yè)界首款支持OpenCL、C和C++的架構(gòu)最優(yōu)化編譯器與多種庫、開發(fā)板，更為FPGA帶來完全類似CPU/GPU的開發(fā)和運(yùn)行時(shí)間體驗(yàn)。

AllProgrammable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司(NASDAQ:XLNX)今日宣布，其面向OpenCL™、C和C++的SDAccel™開發(fā)環(huán)境現(xiàn)已順利通過KhronosOpenCL1.0標(biāo)準(zhǔn)一致性測(cè)試。OpenCL標(biāo)準(zhǔn)為軟件開發(fā)人員提供了一個(gè)統(tǒng)一的編程環(huán)境，使其能夠編寫高效且可移植的代碼，從而能夠在賽靈思FPGA上輕松加速各種算法。作為賽靈思SDx™系列的最新成員，SDAccel包含一個(gè)面向OpenCL、C和C++語言的架構(gòu)最優(yōu)化編譯器，且實(shí)踐證明SDAccel相對(duì)于CPU或GPU將單位功耗性能提高達(dá)25倍，且性能和資源利用率更是其他FPGA解決方案的3倍。

SDAccel開發(fā)環(huán)境結(jié)合了業(yè)界首款支持OpenCL、C和C++的架構(gòu)最優(yōu)化編譯器與多種庫、開發(fā)板，更為FPGA帶來完全類似CPU/GPU的開發(fā)和運(yùn)行時(shí)間體驗(yàn)。

Khronos組織總裁兼OpenCL工作組主席NeilTrevett表示：“看到賽靈思對(duì)于異構(gòu)系統(tǒng)并行編程OpenCL標(biāo)準(zhǔn)的支持，我們非常興奮。FPGA天然適用于計(jì)算密集型算法，在這類算法中，高吞吐量、低時(shí)延和低功耗是滿足系統(tǒng)要求的關(guān)鍵。現(xiàn)在整個(gè)OpenCL設(shè)計(jì)群體都能夠毫無障礙地獲益于賽靈思FPGA所帶來的優(yōu)勢(shì)。”

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