時間:2013-08-08 15:30:11來源:傳動網(wǎng)
針對高速PCB設(shè)計,業(yè)界人士提出了一種新的設(shè)計思路,成為“自上而下”的設(shè)計方法,經(jīng)過多方面的方針分析和優(yōu)化,避免了絕大部分可能產(chǎn)生的問題,節(jié)省了大量的時間,確保滿足工程預(yù)算,產(chǎn)生高質(zhì)量的印制板,避免繁瑣而高耗的測試檢錯等。
阻抗匹配是指負載阻抗與激勵源內(nèi)部阻抗互相適配,得到最大功率輸出的一種工作狀態(tài)。高速PCB布線時,為了防止信號的反射,要求線路的阻抗為50Ω。這是個大約的數(shù)字,一般規(guī)定同軸電纜基帶50Ω,頻帶75Ω,對絞線則為100Ω,只是取整數(shù)而已,為了匹配方便。根據(jù)具體的電路分析采用并行AC端接,使用電阻和電容網(wǎng)絡(luò)作為端接阻抗,端接電阻R要小于等于傳輸線阻抗Z0,電容C必須大于100pF,推薦使用0.1UF的多層陶瓷電容。電容有阻低頻、通高頻的作用,因此電阻R不是驅(qū)動源的直流負載,故這種端接方式無任何直流功耗。
串?dāng)_是指當(dāng)信號在傳輸線上傳播時,因電磁耦合對相鄰的傳輸線產(chǎn)生不期望的電壓噪聲干擾。耦合分為容性耦合和感性耦合,過大的串?dāng)_可能引起電路的誤觸發(fā),導(dǎo)致系統(tǒng)無法正常工作。根據(jù)串?dāng)_的一些特性,可以歸納出幾種減小串?dāng)_的主要方法:
(1)加大線間距,減小平行長度,必要時采用jog方式布線。
(2)高速信號線在滿足條件的情況下,加入端接匹配可以減小或消除反射,從而減小串?dāng)_。
(3)對于微帶傳輸線和帶狀傳輸線,將走線高度限制在高于地線平面范圍要求以內(nèi),可以顯著減小串?dāng)_。
(4)在布線空間允許的條件下,在串?dāng)_較嚴重的兩條線之間插入一條地線,可以起到隔離的作用,從而減小串?dāng)_。
利用差分線傳輸數(shù)字信號就是高速數(shù)字電路中控制破壞信號完整性因素的一項有效措施。在PCB抄板上的差分線,等效于工作在準(zhǔn)TEM模的差分的微波集成傳輸線對,其中,位于PCB頂層或底層的差分線等效于耦合微帶線,位于多層PCB內(nèi)層的差分線,等效于寬邊耦合帶狀線。數(shù)字信號在差分線上傳輸時是奇模傳輸方式,即正負兩路信號的相位差是180°,而噪聲以共模的方式在一對差分線上耦合出現(xiàn),在接受器中正負兩路的電壓或電流相減,從而可以獲得信號消除共模噪聲。而差分線對的低壓幅或電流驅(qū)動輸出實現(xiàn)了高速集成低功耗的要求。
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